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萊迪思半導(dǎo)體推出的新一代iCE40 UltraLite器件 可為OEM廠商豐富移動設(shè)備的功能
近日，萊迪思半導(dǎo)體公司宣布推出新一代iCE40 UltraLite器件，可幫助制造商將獨一無二、極具吸引力的功能添加到最新的移動設(shè)備中，并加速其產(chǎn)品上市進(jìn)程。iCE40 UltraLite FPGA是適用于消費(fèi)類移動設(shè)備和工業(yè)手持設(shè)備，業(yè)界尺寸最小、功耗最低的可編程解決方案。
2015-02-05
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如果FPGA設(shè)計中出現(xiàn)時序違規(guī)，要怎么辦？
前面小編為大家講到《時序約束的一些經(jīng)驗》，這一節(jié)中將談?wù)撎砑蛹s束后進(jìn)行綜合，如果出現(xiàn)時序違規(guī)，會是哪類情況以及該如何去解決。想學(xué)習(xí)這方面知識的童鞋可千萬別錯過，不然后悔別找我??！
2015-02-04
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經(jīng)典電路：FPGA電機(jī)測速系統(tǒng)如何工作？
本次設(shè)計是基于FPGA 的電機(jī)測速系統(tǒng)設(shè)計，利用的是Altera 公司開發(fā)的Quartus II 軟件作為設(shè)計平臺，可以在FPGA 開發(fā)板上實現(xiàn)測量由傳感器轉(zhuǎn)換得到的脈沖信號，并且通過計算得到電機(jī)轉(zhuǎn)速值。
2015-02-04
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菜鳥升級必備：通透了解FPGA設(shè)計流程
初學(xué)者對于FPGA的設(shè)計流程總是束手無策，可能會感覺FPGA的設(shè)計流程冗長繁雜，無從下手。通過EDA設(shè)計工具掌握FPGA設(shè)計流程，這些都不是問題。
2015-01-31
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網(wǎng)友分享：時序約束的一些經(jīng)驗之談
如果設(shè)計的電路只是提供給NIOSII在FPGA內(nèi)調(diào)用，沒有外部器件的相關(guān)延時信息，該怎么約束輸入輸出呢？ 針對一個這位網(wǎng)友給出了時序約束的一些經(jīng)驗之談，分享給大家。
2015-01-29
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工程師入門首選：FPGA學(xué)習(xí)中必須注意的要點
FPGA是工程師入門必須要學(xué)習(xí)的科目，要想學(xué)好這門語言，掌握書本上的知識必不可少，但是資深工程師多年實踐所總結(jié)的要點更是不二法門，只要掌握這些知識，FPGA基礎(chǔ)知識手到擒來，讓你快速升級。
2015-01-22
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特約技術(shù)專家：FPGA仿真器與定制硅仿真器的差異化
該技術(shù)專家10多年以來，一直堅定地支持基于FPGA的硬件仿真系統(tǒng)，并在2013年一直不遺余力地宣傳其優(yōu)勢。自那以后，已成為精通各類硬件仿真專業(yè)知識的顧問，但現(xiàn)在來評論FPGA硬件仿真系統(tǒng)與定制硅硬件仿真系統(tǒng)之間的區(qū)別雖然有些姍姍來遲，但是還是很有必要的。
2015-01-21
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網(wǎng)友探討：FPGA電源設(shè)計適合并行工程嗎？
盡管能夠使用各種開發(fā)工具，今天基于FPGA的系統(tǒng)中還有什么會使得完全遵循這個建議變得不切實際或過于困難呢？對電源設(shè)計師來說，在設(shè)計過程早期就考慮最壞情況而不是最佳情況的電源系統(tǒng)是有好處還是壞處呢，FPGA許多方面存在太多的不確定性適合并行工程嗎？
2015-01-20
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專家支招：如何為FPGA工程師節(jié)省十倍開發(fā)時間
對FPGA工程師而言，耗費(fèi)數(shù)月精力做出的設(shè)計卻無法滿足時序要求，這是一件令人相當(dāng)郁悶的事情。統(tǒng)設(shè)計流程，受限于工程師的經(jīng)驗，因為修改時很可能會引入新的Bug，或者在解決了一條關(guān)鍵路徑的時序問題時，影響到另外一條關(guān)鍵路徑等等，因此并不高效。
2015-01-18
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技巧分享：如何在FPGA內(nèi)實現(xiàn)按鍵消抖？
在FPGA內(nèi)實現(xiàn)按鍵消抖的方法多種多樣，但是最簡單的是采用移位寄存器的方法進(jìn)行消抖。因為移位寄存器的方法不需要對時鐘進(jìn)行分頻，也不需要進(jìn)行延時等復(fù)雜操作。本文就為大家講解這種在FPGA內(nèi)實現(xiàn)按鍵消抖的方法。
2015-01-08
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博客分享：詳解FPGA四大設(shè)計要點
FPGA的用處比我們平時想象的用處更廣泛，原因在于其中集成的模塊種類更多，而不僅僅是原來的簡單邏輯單元本文敘述概括了FPGA應(yīng)用設(shè)計中的要點，包括，時鐘樹、FSM、latch、邏輯仿真四個部分。
2015-01-06
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網(wǎng)友總結(jié)：FPGA時序約束的六種方法
對自己的設(shè)計的實現(xiàn)方式越了解，對自己的設(shè)計的時序要求越了解，對目標(biāo)器件的資源分布和結(jié)構(gòu)越了解，對EDA工具執(zhí)行約束的效果越了解，那么對設(shè)計的時序約束目標(biāo)就會越清晰，相應(yīng)地，設(shè)計的時序收斂過程就會更可控。本文總結(jié)了幾種進(jìn)行時序約束的方法。
2015-01-02
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